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W948D6FB / W948D2FB
256Mb Mobile LPDDR
5. BLOCK DIAGRAM
5.1 Block Diagram
CK
CK
CKE
CS
CLOCK
BUFFER
CONTROL
SIGNAL
RAS
CAS
COMMAND
DECODER
GENERATOR
WE
R
COLUMN DECODER
R
COLUMN DECODER
O
W
O
W
A10
D
E
C
O
R
CELL ARRAY
BANK #0
D
E
C
O
R
CELL ARRAY
BANK #1
D
D
MODE
E
R
E
R
A0
REGISTER
SENSE AMPLIFIER
SENSE AMPLIFIER
ADDRESS
An
BA0
BA1
BUFFER
DMn
DATA CONTROL
CIRCUIT
DQ
BUFFER
DQ0 – DQ15 (x16)
DQ0 – DQ31 (x32)
REFRESH
COUNTER
COLUMN
COUNTER
R
O
W
COLUMN DECODER
R
O
W
COLUMN DECODER
UDM / LDM (x16)
DMn (x32)
UDQS / LDQS (x16)
DQSn (x32)
D
E
C
O
CELL ARRAY
BANK #2
D
E
C
O
CELL ARRAY
BANK #3
R
D
E
R
SENSE AMPLIFIER
-8-
R
D
E
R
SENSE AMPLIFIER
Publication Release Date : Oct, 15, 2012
Revision : A01-004
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